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13. Dynamic characteristics
Table 14.
Dynamic characteristics
Symbol
Parameter
Conditions
Standard-mode
Fast-mode I 2 C-bus
Fast-mode Plus Unit
I 2 C-bus
I 2 C-bus
Min
Max
Min
Max
Min
Max
f SCL
f EXTCLK
t BUF
SCL clock frequency
frequency on pin EXTCLK
bus free time between a STOP
[1]
0
DC
4.7
100
50
-
0
DC
1.3
400
50
-
0
DC
0.5
1000
50
-
kHz
MHz
μ s
and START condition
t HD;STA
hold time (repeated) START
4.0
-
0.6
-
0.26
-
μ s
condition
t SU;STA
set-up time for a repeated
4.7
-
0.6
-
0.26
-
μ s
START condition
t SU;STO
t HD;DAT
set-up time for STOP condition
data hold time
4.0
0
-
-
0.6
0
-
-
0.26
0
-
-
μ s
ns
t VD;ACK
t VD;DAT
t SU;DAT
t LOW
t HIGH
data valid acknowledge time
data valid time
data set-up time
LOW period of the SCL clock
HIGH period of the SCL clock
[2]
[3]
0.3
0.3
250
4.7
4.0
3.45
3.45
-
-
-
0.1
0.1
100
1.3
0.6
0.9
0.9
-
-
-
0.05
0.05
50
0.5
0.26
0.45
0.45
-
-
-
μ s
μ s
ns
μ s
μ s
t f
fall time of both SDA and SCL
[4][5]
-
300
20 + 0.1C b
[6]
300
-
120
ns
signals
t r
rise time of both SDA and SCL
-
1000
20 + 0.1C b [6]
300
-
120
ns
signals
t SP
pulse width of spikes that must
[7]
-
50
-
50
-
50
ns
be suppressed by the input filter
t PLZ
LOW to OFF-state propagation
OE to LEDn;
-
40
-
40
-
40
ns
delay
OUTNE[1:0] = 10 or 11
in MODE2 register
t PZL
OFF-state to LOW propagation
OE to LEDn;
-
60
-
60
-
60
ns
delay
OUTNE[1:0] = 10 or 11
in MODE2 register
t PHZ
HIGH to OFF-state propagation
OE to LEDn;
-
60
-
60
-
60
ns
delay
OUTNE[1:0] = 10 or 11
in MODE2 register
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